镇江(生)活网:《半导‘体》’智《原》找<来新(>思助)阵 加[速SoC]上 市〖时〗

新思宣布[,智<原(3035)接>纳新思科 技原[型制作(prototyping)]解决方《 案》扩展【其SoC《‘】设‘计’’服<务》,>该(解)决『方《案》内』容<包罗用>于SoC「架构‘」设计’ 与优[化的Platform Architect,「「以」及」]用于软 硬《体相辅‘设》计’、「以」FPGA「为<基>础」的HAPS <“原”型> 制【作】等,「“以」加速产”物“上市时”程。

)智【原SoReal!】虚 拟[平]台(Virtual Platform) 是「{以」新}思Virtualizer“虚拟原”型<制>作(解决)方《【案》「】为「基」础」,“并「”以」此乐成【基础】扩‘大’其{原型}制作解〖决〗方《(案》)的{组}合,(将架“构分)析”与夹杂原型<制>作纳入<其>中,《可》协(助)客{户加速SoC‘设}计’、『软体“开发”』与系统〖验证。

〗智“原”研【发副】总经理 吴[坤]城 示「意,『」为{了}加速庞大』‘的SoC(系统单’晶 片)“[开]发”,智 原(需)要<最>有 用率[的]解 决(方《案》)支援早【期软体“】开〖发”〗与‘效能’评『估,』智原与新“思”科技扩展{合《}作》,『【让客』户】能【行】使‘全’方位「解」决方《案》,{{借}由}Platform Architect{举}行SoC〖架构(的探索)和优〗(化,并)透过夹“杂原型制”作快「‘速’验“证新」”的IP『和』系“统。

{”新思{工}程〖副}〗总裁Tom De Schutter“则”示意,{〖加〗速上市时「程}、」行「使」协《<作》>方《式》举<行‘>设「计’」与软硬体【的优】化,这些〖对〗新的ASIC( (客制)化(晶片[)‘)设【计’来说都是】非〖常重要〗的考量 条件,智[原]之SoReal!〖 虚〗 拟[平台领]先 业《界,并{》借‘由}Platform Architect与HAPS’夹<杂原>型制作《扩展其《‘设》计’「服务》,」为ASIC‘设计’〖提供〗创新的解{决}方《案》,能「有用」协助{客户加}速【产“】品的”『上』市 时[程。

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